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Advance Member
  
加入日期: Apr 2005
文章: 479
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引用:
你確定有把wikipedia裡的 CPU Cache那篇看完嗎?  講簡單一點的 就是Intel在分支預測技術導致L2的大小長這樣，當然u860111講的8way、2way也是原因之一... 而實際上就我的了解 目前AMD與INTEL在Cache 設計概念上已經是南轅北轍 詳細的狀況google找一下應該就有 另外 對於 CPU design部份 我比較熟的也僅止於 ALU與PLL，有幾分實力說幾分話  讓有實務的版友去補完吧 
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提高計算速度的方法不只一種。 平行計算只是一種提高效率的方式，具有不確定性與複雜性。關於提高效率的方式，存在著各種不同的理論。 對於我們來說，那並不是完美的東西。 |
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2007-05-10, 11:07 AM
#21
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Advance Member
加入日期: Jan 2005 您的住址: Mars
文章: 463
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正是時脉和製造工藝的緣故,使得Intel不得不增加PipeLine的數量. 這樣做的確可以很順利的提升CPU的時脉,但帶來的負面效果就是執行效率的低下跟功耗的增加. 這也就是爲什麽性能相近的 P4 跟Athlon 兩者之間的時脉跟髮熱量要相差很多的原因所在.
如果有興趣的話,大可以用Google搜索一下當年NorthWood核心的P4跟Athlon之間PipeLine之間數量的差距. 現在的Core2又回到了P3的問題解决方式, PipeLine的數量也降低了很多,從架構的角度來看,這樣做的缺點是沒辦法像當年P4那樣一個勁的提升時脉,但現在的製造工藝卻彌補了這個缺憾,加上優良的架構設計提昇了CPU的執行效率,成就了Core2的今天. PS:爲什麽PipeLine數量過多會讓運行效能降低,這就要牽扯到 Branch Prediction了,一旦Branch Prediction 中的某一個過程失敗,整個過程就要重頭開始,PipeLine太長,自然消耗的時脉要多一些. 過多的時脉消耗在這上面,自然就會降低CPU的執行效能. 而PipeLine過長也會導致Branch Prediction 失敗可能性的增加.
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路在何方？ |
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2007-05-10, 12:55 PM
#22
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Master Member
加入日期: Feb 2002 您的住址: 楓葉與霜晶的華爾滋
文章: 1,862
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Netburst是I老大在時脈等於效能的思考模式下的產物。結果搞出了only 時脈的笨蛋四系列。也讓AMD賺了不少。
如果說I老大推Netburst的缺點在哪裡，就是鐵齒的時間不夠久。至少也得抱著那個廢物Netburst直到完全失去市場主導為止。
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2007-05-27, 04:53 PM
#23
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