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Power Member
 加入日期: Mar 2003 您的住址: 台北
文章: 597
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引用:
你說的是Z-ram吧 那應該只能用在L3上 |
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2006-05-17, 06:22 PM
#11
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Basic Member
加入日期: Feb 2006
文章: 20
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引用:
上面的寫的滿清楚的啊! 關鍵就在可以用二層的時候為什麼要用三層的快取。 我想 AMD 概念上大概是用兩組雙核再加一個 shared 的 L3 去做，才變成你形容的樣子。 可以用二層解決不用而得用三層，那就是一種浪費。所以樓上的才說可能得重新再設計成二層的架構比較好啊。 |
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2006-05-17, 06:32 PM
#12
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*停權中*
加入日期: Aug 2005 您的住址: ASUS AOOP爆肝團
文章: 282
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k8原生設計就用了5年,現在就只在小細節上變來變去
這樣效能會提昇多少?....還是砍掉重練換k10好了 |
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2006-05-17, 06:57 PM
#13
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Major Member
加入日期: Feb 2006
文章: 147
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K8L Die Size跟 Conroe幾乎一樣大,但是頻率會到多少是個問題
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2006-05-17, 06:59 PM
#14
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Power Member
加入日期: Mar 2003 您的住址: 台北
文章: 597
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引用:
哇勒 不是這個樣子吧 4核使用share L3跟兩組雙核加share L3有啥關係 應該是看成四個用cross-bar互連的單核加上share L3 還有可做兩層為何要做三層 你可以去問問IBM,intel 為什麼他們之後要發表的Power6或是Itanic 2(IA-64) 都是用dedicated cache再加上share L3 這不是浪費嗎?? 我之前都說的很清楚了 dedicated和share是有trde-off的 怎麼很多人老是看到intel用什麼就覺得什麼最好哩?? 此文章於 2006-05-17 07:04 PM 被 alience 編輯. |
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2006-05-17, 07:00 PM
#15
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Power Member
加入日期: Mar 2003 您的住址: 台北
文章: 597
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引用:
你說的k8L是四核還是雙核 四核跟雙核一樣使用65nm,die size一樣大 我想AMD還沒這麼厲害 |
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2006-05-17, 07:02 PM
#16
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Major Member
加入日期: Feb 2006
文章: 147
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引用:
K8L : 150mm2 Conroe: 140mm2 |
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2006-05-17, 07:08 PM
#17
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Golden Member
加入日期: Aug 2004 您的住址: 「 」
文章: 2,517
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引用:
K8-L 的"L"就是指4核 如果雙核就是X2系列，還蠻好記的阿  |
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2006-05-17, 07:10 PM
#18
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Major Member
加入日期: Dec 2000 您的住址: Taipei
文章: 296
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不至於吧
雖然上面圖片只有幾句話,但是微處理器架構要改很多呢 這樣子的改變甚至比K7到K8還來得大 K8L看來不只是一顆TWEAKED K8而已 引用:
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2006-05-17, 07:19 PM
#19
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Elite Member
  
加入日期: Jan 2002 您的住址: 閃亮亮的永和*~
文章: 6,096
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引用:
首先，看這種放大圖怎麼可能知道真實面積  我講的是大小比例，以前K8的L2面積比核心還大，現在比核心小那麼多，當然是因為L2縮小了啊。 至於快取頻寬share的問題，我想至少比記憶體頻寬被share好多了。 以前intel雙CPU主機板(例如440BX)共用一個北橋頻寬，那才真的是災難  分享式設計的優點在百核心這個想法下是有利的，因為每個核心都很小，同樣的面積可以塞入更多核心，在多線序軟體的支援下，或許L2頻寬被瓜分的缺點不會那麼明顯。 反正目前intel的想法是盡量塞核心，何時會達到性能瓶頸，大家等著看 
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2006-05-17, 08:00 PM
#20
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