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kodjou
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加入日期: Jun 2003
您的住址: 台北
文章: 1,183
還有 不要用注音文 不要以為是新手就安全 發文 文化要搞清楚
     
      
舊 2005-04-11, 12:44 AM #11
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kodjou離線中  
beck90237
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加入日期: Jul 2004
文章: 545
所以這叫做入境隨俗...哈哈= =
 
__________________
各領域的論壇討論
舊 2005-04-12, 10:46 AM #12
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beck90237離線中  
你想蛋嘛
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你想蛋嘛的大頭照
 

加入日期: Nov 2004
您的住址: 台中、台南
文章: 514
新手不知道文化丫,稍微講一下就好了,不要這麼火大嘛...
不過現在各大網站都排除了注意文,新手本身真的也不要懶...
選個字是會花多少時間?不然就去學別的輸入法吧~
其實也不會很難,我也是自己看書學的,至少學會後真的很方便,也不用按shift切換
__________________
聽人家說...
工作 就像輪** 你不行了 就換別人上...
生活 就像**** 什麼都要靠自己的雙手...
學習 就像召妓 又出錢又出力...
發薪 就像是月經 一個月不來那麼一次總覺得不能安心!!!
人生 就像被強暴 要不就睜開眼睛反抗 要不就閉上眼睛享受...

--

主要硬碟原廠診斷程式和低階格式化
Hitachi Feature tool 使用指示
AMD Socket AM2 平台 除頻數/DDR2時脈搭配 參考文章
Intel LGA775 Socket 平台 DDR2除頻數/DDR2時脈 搭配 參考文章
AMD Socket AM2 平台 各家廠商 有兩組IDE裝置 主機板型號列表
舊 2005-04-12, 02:02 PM #13
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你想蛋嘛離線中  
kittyming
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加入日期: Aug 2001
文章: 127
引用:
作者ckgc
我教你 今天剛考完台大回來 記憶猶新

L1快取最好是小一點 這樣可以使得電子訊號傳遞較快且邏輯閘較少,使得邏輯delay較少,
而導致hit time較低,所以效能得以提升, 大部分建議16K~64K為主

因為L1快取 miss rate 通常不高 , 大概只有2%~5% , 所以L2快取的第一優先考量已不再是hit time了,而是如何捕捉這2%~5%的 cache miss , 使得他不要在L2 cache 時再 miss一次 , 若連L2 cache都 miss , 則這個 miss penalty 是相當高的 , 理由為:要到Memory去抓資料要花費相較於cache 10倍~1000倍 的時間 , 所以L2 cache 傾向於大容量的設計 , 才能避免這個高的嚇人的失誤代價 .

這位大大厲害喔,台大題目出的難嗎?
在計算機概論中L1是register,L2是cache memory,的確register的hit rate很高,所以增大cache memory可以提高hit rate,資料在cache找到就可以減少到main memory的存取次數,提高效率。
這位大大用功喔,這位大大是考資工的嗎?

此文章於 2005-04-12 04:34 PM 被 kittyming 編輯.
舊 2005-04-12, 04:33 PM #14
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kittyming離線中  
NONO72324
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NONO72324的大頭照
 

加入日期: Apr 2001
您的住址: 台北
文章: 395
應該要說Intel和AMD對於L1和L2的設計方面是走不同的方向
只用CPUMARK 99的成績來決定那種CPU效能較強其實是很
牽強的
__________________
我就是我!!
舊 2005-04-12, 04:47 PM #15
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NONO72324離線中  
東瀛魔神
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東瀛魔神的大頭照
 

加入日期: Jul 2000
您的住址: 台北
文章: 5,307
整體快才重要

像 PI 和 CPU MARK 也有爭議呀

且....要比也要比相近的產品吧
__________________
玩Go Kart請使用安全帽!!!

歡迎自行取用
COWA會員卡:013690
燦坤編號:26244595
舊 2005-04-12, 06:31 PM #16
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東瀛魔神離線中  
ckgc
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ckgc的大頭照
 

加入日期: Jan 2004
文章: 279
引用:
作者kittyming
這位大大厲害喔,台大題目出的難嗎?
在計算機概論中L1是register,L2是cache memory,的確register的hit rate很高,所以增大cache memory可以提高hit rate,資料在cache找到就可以減少到main memory的存取次數,提高效率。
這位大大用功喔,這位大大是考資工的嗎?


對 我是考資工的
台大資工題目不難 , 台大電機計算機組題目很難 唉~


L1 跟 L2都是Cache
L1是做在CPU核心裡的 L2是做在CPU外面的但是跟CPU封裝在一起
CPU內另外有register
register很小 通常一個register只能裝4byte~8byte的容量
一個CPU大約有32 ~ 128個register
register主要拿來暫存data做運算
或是拿來定址用的~

所以register跟cache還是有點不同

register 又比 cache 快多了 , 但容量相對少很多
舊 2005-04-12, 06:37 PM #17
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ckgc離線中  
kittyming
Major Member
 

加入日期: Aug 2001
文章: 127
引用:
作者ckgc
對 我是考資工的
台大資工題目不難 , 台大電機計算機組題目很難 唉~


L1 跟 L2都是Cache
L1是做在CPU核心裡的 L2是做在CPU外面的但是跟CPU封裝在一起
CPU內另外有register
register很小 通常一個register只能裝4byte~8byte的容量
一個CPU大約有32 ~ 128個register
register主要拿來暫存data做運算
或是拿來定址用的~

所以register跟cache還是有點不同

register 又比 cache 快多了 , 但容量相對少很多

呵呵!好險沒考台大,不然又當炮灰,這題沒分
舊 2005-04-12, 07:13 PM #18
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kittyming離線中  
forum
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加入日期: Feb 2003
您的住址: 臺屬釣魚台群島小強控股公司
文章: 454
引用:
作者ckgc
我教你 今天剛考完台大回來 記憶猶新

L1快取最好是小一點 這樣可以使得電子訊號傳遞較快且邏輯閘較少,使得邏輯delay較少,
而導致hit time較低,所以效能得以提升, 大部分建議16K~64K為主

因為L1快取 miss rate 通常不高 , 大概只有2%~5% , 所以L2快取的第一優先考量已不再是hit time了,而是如何捕捉這2%~5%的 cache miss , 使得他不要在L2 cache 時再 miss一次 , 若連L2 cache都 miss , 則這個 miss penalty 是相當高的 , 理由為:要到Memory去抓資料要花費相較於cache 10倍~1000倍 的時間 , 所以L2 cache 傾向於大容量的設計 , 才能避免這個高的嚇人的失誤代價 .

hit time??? Academia 的norm 是 access time 吧

還有Larger L1 size 對logic delay 影響沒那麼大
主要是wire delay
舊 2005-04-12, 11:30 PM #19
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forum
Advance Member
 

加入日期: Feb 2003
您的住址: 臺屬釣魚台群島小強控股公司
文章: 454
引用:
作者ckgc
對 我是考資工的
台大資工題目不難 , 台大電機計算機組題目很難 唉~


L1 跟 L2都是Cache
L1是做在CPU核心裡的 L2是做在CPU外面的但是跟CPU封裝在一起
CPU內另外有register
register很小 通常一個register只能裝4byte~8byte的容量
一個CPU大約有32 ~ 128個register
register主要拿來暫存data做運算
或是拿來定址用的~

所以register跟cache還是有點不同

register 又比 cache 快多了 , 但容量相對少很多

L1 跟 L2 都可以做在CPU 外
也可以和Core 有緊密的結合

還有LS architecture 才是讓reg 和cache 有明顯差別的地方
舊 2005-04-12, 11:38 PM #20
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