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lifaung
Senior Member
 

加入日期: Aug 2001
您的住址: 台中or桃園
文章: 1,134
引用:
作者a486207045
這哪個天兵的劃分呀??
號稱10以下全球才3家在做 台積 三星 INTEL 算啥成熟製程?
1X的話就在加個聯電 GF 特許應該有 就連日本先進現在都沒有的東西被喜說是成熟製程.....

真的成熟製程都是22/28以上的製程了


敝公司的成熟製程定義是40nm以上的才算
22/28還是一堆人開不起光罩
     
      
舊 2025-08-26, 12:33 PM #141
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lifaung離線中  
lifaung
Senior Member
 

加入日期: Aug 2001
您的住址: 台中or桃園
文章: 1,134
引用:
作者銀鐵人
川普早就在排除中國成熟晶片
https://tw.news.yahoo.com/%E4%B8%AD...-102733923.html


排除, 是想像還是能做到還是兩碼子事情

不要等下變成被夾殺XD
--
ESP32就是很好的例子
 
舊 2025-08-26, 12:36 PM #142
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lifaung離線中  
lifaung
Senior Member
 

加入日期: Aug 2001
您的住址: 台中or桃園
文章: 1,134
引用:
作者skap0091
底下留言:
然後300%晶片關稅後就沒有然後了

中國之前是世界工廠,2025中國製造已達成大多數目標
老美現在才想把製造業拉回本土
再怎麼逼迫我認為最終也是要遵從市場機制
簡單說,中國產品製造量屌打美國,成熟製程內需也屌打美國
中國無人機、電動車、機器人等等領域,都量大價廉
那邊隨便小訂單的產品都能搞到自己需要的晶片來做生意
老美根本沒有這種模式也很難複製過來


其實只要問一句, GaN在哪裡做就已經要結束這個話題了
舊 2025-08-26, 12:37 PM #143
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lifaung離線中  
a486207045
Major Member
 

加入日期: Nov 2011
文章: 255
引用:
作者lifaung
敝公司的成熟製程定義是40nm以上的才算
22/28還是一堆人開不起光罩

但說22/28算是一般公認的成熟製程上限應該不為過
而且成熟製程還是有很多可以玩的 像是耐壓 高溫寬 或是這幾年的GaN
說真的 美軍要的電子儀器也不會要先進製程的產品
老川要確保先進製程在美生產其實意義真的不大
先進製程? INTEL已經有了 良率問題其實就美國人工作態度的問題 神仙難救

製程這東西要靠一堆不需要那麼天才的人操作儀器 收集樣品 切片分析 歸納可能原因 提出改善方案 再回到第一步這樣一直跑下去 這不光是自己廠內的人員 也需要協力廠配合 美國找不到那摩多以廠為家的人來做這些事 自然沒辦法跟台積電競爭
舊 2025-08-26, 02:22 PM #144
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a486207045離線中  
supermaxfight
Golden Member
 
supermaxfight的大頭照
 

加入日期: Jun 2002
您的住址: 地獄18層
文章: 3,250
3nm實際並不是整顆晶片所有線路都只有3奈米寬
有沒有高手大大來開釋一下這個
__________________
徵你不要的AM4 CPU
徵你不要的SATA接頭斷裂SSD
舊 2025-08-26, 02:37 PM #145
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supermaxfight離線中  
Hermit Crab
Golden Member
 

加入日期: Oct 2017
您的住址: 象山公園
文章: 2,795
引用:
作者supermaxfight
3nm實際並不是整顆晶片所有線路都只有3奈米寬
有沒有高手大大來開釋一下這個


INTEL之前卡在祖傳14奈米的時候不就開始大肆宣傳GG和三爽的數字非常具有欺騙性。
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感謝網友提供的篡改猴script, 可惜失效了
舊 2025-08-26, 02:43 PM #146
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Hermit Crab離線中  
goodpig
Master Member
 

加入日期: Sep 2001
您的住址: 高雄
文章: 2,172
引用:
作者skap0091
7nm算進成熟製程??麻煩您提供來源,最好是比較有可信力的
多來幾個證明一下不是您自己腦補出來的

你自己搜尋「成熟製程定義」就有很多相關文章了
這本來就沒有標準答案,廣義狹義定義各自解讀
台積電自己對於先進製程的定義就是7以上

我當然也是有先搜尋過,我可沒有說你哪邊講錯了,沒有必要這麼兇

只是要強調,成熟製程的定義本來就是彈性的,也會隨製程進步而變動
幾年後中國成熟製程占比越來越高這一定會到來
但到時候5奈米對於台積電來說也很有可能已經算是成熟製程
舊 2025-08-26, 02:51 PM #147
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goodpig離線中  
Hermit Crab
Golden Member
 

加入日期: Oct 2017
您的住址: 象山公園
文章: 2,795
引用:
作者銀鐵人
川普早就在排除中國成熟晶片


底下第一個留言:
然後300%晶片關稅後就沒有然後了

這兩年靠著晶片,台灣對美貿易順差創下新高,
有些人理解為這是天大喜訊,川普關稅這樣一弄成了催命符。
__________________
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舊 2025-08-26, 03:00 PM #148
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Hermit Crab離線中  
a486207045
Major Member
 

加入日期: Nov 2011
文章: 255
現在說3nm 2nm的都是假的
正確說法是 電晶體密度(或者說閘寬寬度)等同推定3nm 2nm的產品
怎麼推定? 就照最原始的製程設計推測3nm 2nm會有的數據來比較
現在電晶體設計與堆疊方式都跟1X-2X年不同了 不然哪真能3nm 2nm的閘寬
只有一二十個原子連成的(線路) 光量子效應就不知道自己在測啥了
舊 2025-08-26, 03:04 PM #149
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a486207045離線中  
blair
Elite Member
 
blair的大頭照
 

加入日期: Jun 2001
您的住址: 地球
文章: 6,234
引用:
作者supermaxfight
3nm實際並不是整顆晶片所有線路都只有3奈米寬
有沒有高手大大來開釋一下這個

intel卡在10奈很久就是因為10奈以後要符合傳統的節點定義已經有極大的困難
看看10奈以前節點的數字就會知道有個規律性在
10奈進一階記得應該是7奈
10奈以後
台積電三星的做法就是實際上就是在設計上這邊弄一點那邊縮一點,
而不是一定要照傳統節點定義
"然後效能有明顯超過既有節點我就宣稱一個"
所以其實5奈3奈2奈全都是"宣稱",跟傳統定義不同的
intel腦袋轉不過來
一直在那10+++++然後糾結台積三星的做法
問題是人家的效能真的慢慢上來...
東擠一點西縮一點,也能積累製程經驗與know-how

真的有照傳統定義的話
AMD早就把intel踩在地上輾了
而不是像現在這樣纏鬥
現有core ultra是設計上的特性導致遊戲性能不如amd
而不是"製程落後"導致
而X3D的設計也只對遊戲有用,宣傳意義大於實質
__________________
~愛由一個笑容開始,用一個吻來成長,用一滴眼淚來結束。
當你出生時你一個人在哭,而所有在旁的在笑,因此請活出你的生命,
當你死的時候,圍繞你的人在哭而你便是唯一在笑。~
舊 2025-08-26, 03:11 PM #150
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blair離線中  


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