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a486207045
Major Member
 

加入日期: Nov 2011
文章: 255
引用:
作者goodpig
你自己搜尋「成熟製程定義」就有很多相關文章了
這本來就沒有標準答案,廣義狹義定義各自解讀
台積電自己對於先進製程的定義就是7以上

我當然也是有先搜尋過,我可沒有說你哪邊講錯了,沒有必要這麼兇

只是要強調,成熟製程的定義本來就是彈性的,也會隨製程進步而變動
幾年後中國成熟製程占比越來越高這一定會到來
但到時候5奈米對於台積電來說也很有可能已經算是成熟製程


啥?? 原來是AI大師呀 真是失敬
能列成熟製程主要就價格相對便宜且穩定(會做的公司多了) 然後可大致預測良率(各種產品都有人做 東西沒特別冷門的話 良率多少翻資料就知)
沒有以上兩點特性的話 算哪門子成熟製程?
     
      
舊 2025-08-26, 03:40 PM #151
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a486207045離線中  
銀鐵人
Amateur Member
 
銀鐵人的大頭照
 

加入日期: Apr 2017
文章: 30
我認為所謂成熟製程是指許多公司都能做的意思,先進製程則是少數公司能做的
 
舊 2025-08-26, 04:11 PM #152
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銀鐵人離線中  
Crazynut
Master Member
 

加入日期: Apr 2001
您的住址: 高雄
文章: 2,247
引用:
作者銀鐵人
我認為所謂成熟製程是指許多公司都能做的意思,先進製程則是少數公司能做的
簡明扼要。
硬要指定多少規格是有時間性的,說不定吵個三天後,先進都不先進了。
__________________
簽名檔真是礙眼…還是讓版面乾淨點吧!
舊 2025-08-26, 04:35 PM #153
回應時引用此文章
Crazynut離線中  
skap0091
Master Member
 

加入日期: May 2021
文章: 1,972
引用:
作者supermaxfight
3nm實際並不是整顆晶片所有線路都只有3奈米寬
有沒有高手大大來開釋一下這個

我早就開過主題了,影片解析得很清楚明白

電子顯微鏡下的台積電2代3nm末代FinFET
https://www.pcdvd.com.tw/showthread.php?t=1214795

放大20萬倍,這是3奈米晶片最深層的秘密【玄戒O1解剖報告】
https://youtu.be/Q9oJnTmpMg8?si=igV1spDeZnQMmEWz
舊 2025-08-26, 05:51 PM #154
回應時引用此文章
skap0091離線中  
hendry2002
Major Member
 
hendry2002的大頭照
 

加入日期: Jan 2008
您的住址: 銀河系
文章: 167
每家公司對成熟製程跟先進製程的定義不同

就拿Synopsys跟Cadence這兩家全球最大的EDA公司來說

他們定義的 Advance node(先進製程)指的是7nm往上 亦即5nm 3nm 2nm

mature node(成熟製程)指的是7nm往下(不包含7nm) 亦即10nm 14nm.....

這兩家EDA公司在不同製程提供的軟體價格可是不同的 天差地別

__________________
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冰的啦魔王大人
沒問題
舊 2025-08-26, 10:04 PM #155
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hendry2002離線中  


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