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Elite Member
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引用:
最初由 starbd 發表
我好奇的有
1.有沒有採用同位素超純矽材料?
2.L2 cache的latency有沒有最佳化;寬度有沒有改成256byte( now 64)
k7無法拉大與 p3的差距就受制在L2 cache的latency與資料寬度....
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TB也是因為這樣時脈才拉得上去,
PIII就是因為L2 Latency過短,時脈才拉不上去.
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~愛由一個笑容開始，用一個吻來成長，用一滴眼淚來結束。
當你出生時你一個人在哭，而所有在旁的在笑，因此請活出你的生命，
當你死的時候，圍繞你的人在哭而你便是唯一在笑。~
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