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引用:

作者AARONN

請問一下..
3. 因為採PCI-e 2.0 2Lane設計，推論對部分低階M/B可能會出現搶頻寬
這句話是什麼意思?? 會有相容性的問題嗎?? 還是使用上有問題??

應該是考量CPU與PCH之間的總頻寬小於PCH提供的8條GEN2x1所需的總頻寬，更不用提其他I/O裝置了這點．

雖然說實際上要佔滿的機會微乎其微就是了．