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a23919763 2007-03-14 04:18 PM

說句題外話,自從搬出宿舍之後,JLurker大的eMule 20.52TB上傳 圖 就成為小弟永遠不可能的夢想了......(住了一年,大多在下載,但上傳也有2TB)

JLurker 2007-03-14 05:17 PM

引用:
作者a23919763
說句題外話,自從搬出宿舍之後,JLurker大的eMule 20.52TB上傳 圖 就成為小弟永遠不可能的夢想了......(住了一年,大多在下載,但上傳也有2TB)

唉,小弟離大學住宿生活很遠了 :stupefy: 那是大三上的圖檔,最後畢業可能有破百TB上傳吧...
現在苦命的用Cable...3M/640K.... :think:

bgg1018 2007-03-14 06:22 PM

引用:
作者JLurker
隨手找了些資料
http://www.computerdiy.com.tw/modul...ryid=246&page=0

同樣是A64(比較古老,是754的)
時脈同樣都是2000Mhz,但一個是512KB,一個是1MB
效能還是有差異,但不是非常明顯(當然效能不會是2倍)
但至少有5%~15%的差距
現在的AM2基本上跟754時代核心修正不多,所以相信效能差異512KB與1MB大約也是這個差距
更不要說754時代大家搶1MB版本而不要512KB版本的A64 3000+

以AMD的角度來說,1MB版本的die size幾乎是512KB的1.5倍以上
請問你要生產2顆1MB還是3顆512KB?
當然是三顆512KB比較好賺錢,還可以把1MB版本推出來賣FX....

拿128bit做為L2 cache不能做大的理由實在是太牽強....至少這絕對不是"主要因素"...


小弟有些疑問了~看了一下報導
怎覺得反而是K8的架構上在快取比CORE 2 DUO的好
為啥K8在測試中只有I/O存取延遲低部分會比CORE 2 DUO好上1~2倍


Athlon 64具備128KB L1 Cache,由64KB指令快取加上64KB資料快取所組成
這邊也比扣肉快取大不少~而且還是雙向

L2 Cache介面寬度64-bit,採16向結合性(16-way associative)架構設計,Pipeline Stages管線階深度達到整數12階、浮點17階,比Athlon XP的10階(整數/浮點)來得深,對於Athlon 64的時脈推升有正面助益。

扣肉只有8-way associative~所以不管怎看K8還是有優勢
只是效果在測試中卻沒顯示出來的說

而且我也有疑問對於L2快取誰的製程256bit頻寬優勢
p3就有256bit頻寬???!!
看k8架構也是因該有吧??!!
128位元SSE/SSE2浮點暫存這個也是相對都有吧~還是扣肉已經達到256bit了??!!
也很莫名其妙的說~希望有大大能夠解說一下~謝謝

Crazynut 2007-03-14 06:49 PM

設計不同,架構不同,比這個實在沒有什麼意義。

Tu的確是一個特例,同時期的P4,只要不超過2G的,表現都不見得比Tu好,理由無它,因為早期P4的長管線本來就是要在高時脈才能發揮出來。這種事以前也曾發生過,PⅡ233就不會比Petium233好。

可是我們也不能依據這一點,就將P4看的一文不值。我個人倒挺贊同,到C0製程的2.6G,是P4系列的經典與顛峰之作,大幅拉開與K7的差距。

只是P4後期時脈飆得太高,E0製程的幾乎每顆都是吃電大怪物,搞得電腦一開機就轟轟作響…留下一筆不太光榮的紀錄…


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