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- - 3~12相供電...每相由3顆MOS FET+固態電容+電感..組成.這是什麼作用?
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Hi Foxly Visionary 1024Bits 三位好.
民國66~72年我lay過太多Audio的板子,72~80年轉行外商業務,80年退休至今近20年...ㄧ直到2006因小孩的需要我才從"零"開始自學PC...謝謝各位的指導! 台製mosfet的RDS已很低很低....發熱量已大大改善·mos的體積變小了很多! 最近正準備買進國內mosfet大厰股票826X.....看好下半年mos的行情。 上半年因eepc也賺了一小筆...eepc共用了16顆電源管理IC...向關渡求証後"買進"小賺30%已出場!我看好未來兩三年~5年的景氣! |
引用:
在下不是RD，只是一個小小高科技苦力，希望在下的資訊能對您有用。 1.早期的處理器從386/486開始，到P54C/P55C等，都是由5V，經過線性降壓/單相式交換降壓電路來供應核心電壓，直到P4開始，才使用12V，經過獨立的VRM迴路供應Vcore，不過其週邊I/O信號電源準位，則仍是以3.3V為主。 2.同1，是主要由Vcore所屬之VRM產生之。 3.VRM每相採同步式交換降壓電路設計，也就是至少有一高端(與電源相接，High-side，用來控制電源通過與否)、一低端(與接地相接，Low-side，用來控制電感儲能釋放)、一儲能電感、一些電容，與其周邊的HS/LS Driver(驅動器)，依照PWM控制器可控相數多寡，以及電路需求，會有2~8組相同的電路(有些甚至多到16組)，就是俗稱的幾相電源。而這些元件，都會依電路需要，進行並聯來增大其輸出能力，就像是把一顆引擎經過"擴缸"來加大輸出動力是一樣的道理，上述電路所需的數值，都須經過公式計算，方能求出其最低要求值。 4.各相的輸出，都會先接至處理器插槽底下的Vcore layer，然後通入其對應的Vcore接腳，盡量求在最短路徑內傳輸。隨處理器腳位的不同，用來輸送Vcore的接腳數目也會不同。 5.照理說每一相應平均分擔總輸出電流，不過單位時間內，僅會有一相處於輸出模式，仍會在負載量變動時，可能造成單一相負載增加，所以設計需要考慮安全電流數值，因為每一相輸出是並聯的，所以電壓均相同，隨著處理器提供的VID資訊以及電路Offset值進行調節。 6.因為電感作為儲能/釋放元件，加上流過電流大，電與磁間轉換產生的損失便成為廢熱。 7.每一相輸出，經過電容平滑後，照理說應為直流，不過隨輸出量增加，其漣波(ripple)與雜訊(noise)會逐漸增加，其漣波頻率約略為Fpwm x phase。 |
引用:
應該用多缸引擎來形容比較正確... |
Hi LSI
謝謝你的說明,很棒!能幫忙給我一張(ㄧ個相就好)2H2L的線路簡圖嗎? FAX: 02-24656244 MAIL: 讓我"聞香"ㄧ下....都快60歲了!! |
引用:
原來如此，我還是猜錯了 PWM 的工作原理，原本以為相數越多，每相所需負擔的電流就越小。 行家出手果然不同凡響 :shy: |
引用:
這裡是指每相透過HS/LS並聯等方法增大電流承載力，所以說是"擴缸"(增大每缸輸出動力)。 |
引用:
運作的單位時間內，相數越多，各相所需承受的時間也越短，有助於減輕其負載量，每一相元件容量也不用那麼龐大(MOSFET的特性是於短時間內容許承受超載)。 |
引用:
 將電路中Q1及Q2採用雙顆並聯就成了2HS+2LS的單相同步降壓交換式電路。 |
引用:
謝了,劃得很好,請問以8相為例它們的週期....每相每次供電多少微秒?我有ㄧ同班同學/室友...他目前供應很多內銷diy市場上大power的power supply...改天我會找他深入了解2H2L的計算方式.... |
引用:
這與Fpwm以及其duty cycle有關，詳細需要視電路參數來進行計算。 |
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